答案：在编译该verilog文件时，使用-L 指定所包含的库即可举例说明：如上是某个工程仿真的sim.do内容：1.第1-3行是在./libraries/路径下新建三个空库(暂时是空的)2.第5行是编译 alt_vip_common_pkg.sv 文件放进 altera_common_sv_pac…

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